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搜索资源列表

  1. trunk-hdlc.rar

    1下载:
  2. 高级链路层协议的实现,vhdl,fpga,- 8 bit parallel backend interface - use external RX and TX clocks - Start and end of frame pattern generation - Start and end of frame pattern checking - Idle pattern generation and detection (all ones) - Idle pattern
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-25
    • 文件大小:183.91kb
    • 提供者:whs
  1. frame_synchronization.rar

    1下载:
  2. 检测巴克码实现帧同步传输,vhdl语言,帧头,Detection of Barker code transmission to achieve frame synchronization
  3. 所属分类:VHDL编程

    • 发布日期:2013-03-22
    • 文件大小:432.35kb
    • 提供者:chenke
  1. SDHAnalysis

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  2. 光纤通信中的SDH数据帧解析及提取的VHDL实现源代码,共包含帧同步、E1及F1码流提取、DCC1码流提取、帧头开销串行输出四个主要模块-SDH fiber-optic communication data frame analysis and retrieval implementation of VHDL source code, include the frame synchronization, E1 and F1 stream extraction, DCC1 stream extra
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:30.75kb
    • 提供者:张晓彬
  1. AIC

    2下载:
  2. 使用FPGA/CPLD设置语音AD、DA转换芯片AIC23,FPGA/CPLD系统时钟为24.576MHz 1、AIC系统时钟为12.288MHz,SPI时钟为6.144MHz 2、AIC处于主控模式 3、input bit length 16bit output bit length 16bit MSB first 4、帧同步在96KHz-The use of FPGA/CPLD set voice AD, DA conversion chip AIC23, FPGA/
  3. 所属分类:嵌入式/单片机编程

    • 发布日期:2014-01-13
    • 文件大小:1.54kb
    • 提供者:张键
  1. control

    0下载:
  2. 用VHDL语言编写的一个控制程序,主要功能是输入码同步,输出字和帧信号-VHDL language using a control program, the main function is to input code synchronization, and frame signals output word
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:5.62kb
    • 提供者:cloudy
  1. E1

    0下载:
  2. 分析帧同步算法,提供帧同步的状态机实现图以及得到的正确仿真图形。-Analysis of frame synchronization algorithm, to provide frame synchronization state machine implementation plans and get the correct simulation graphics.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:94.29kb
    • 提供者:李逊
  1. bakema

    0下载:
  2. 巴克码发生器的VHDL程序,巴克码主要用于通信系统中的帧同步,便于与随机的数字详细相区别,易于识别。-Barker Code Generator VHDL program, Barker Code is mainly used for frame synchronization in communication systems, and the random number to facilitate more differentiated and easy identification.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:334.1kb
    • 提供者:andy
  1. VHDL-zhengtongbutiqu

    0下载:
  2. 基于VHDL帧同步提取建模与设计 该设计主要是在一帧数据的前后插入巴克码-Based on VHDL frame synchronization extraction modeling and design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:50.32kb
    • 提供者:启哈发
  1. zhentongbu_VerilogHDL

    0下载:
  2. 帧同步的VHDL程序源代码,巴克码同步实现。-Frame synchronization of the VHDL source code, Barker code synchronization
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:154.54kb
    • 提供者:陈晗卿
  1. zhentongbu

    0下载:
  2. FPGA在通信上的运用:基于VHDL的帧同步程序-Application of FPGA in communication: Based on VHDL frame synchronization procedures
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-15
    • 文件大小:489.4kb
    • 提供者:杨涛
  1. frm_sync

    0下载:
  2. 此程序为帧同步程序,采用状态机的VHDL描述方式编写。-This procedure for frame synchronization procedures, using the state machine to prepare the way VHDL descr iption.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.13kb
    • 提供者:chenjinhao
  1. ba_ker

    0下载:
  2. 巴克码装到信息内同时将巴克码识别出来,实现帧同步的VHDL设计-Barker code loaded to the information identified while Barker code, VHDL design to achieve frame synchronization
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:822byte
    • 提供者:张志健
  1. vhdlll

    0下载:
  2. VHDL实现帧同步的巴克码器,含有移位寄存器,判决器、译码器。-VHDL realize frame synchronization barker code, contains a shift register, judgment, decoder.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:304.34kb
    • 提供者:徐高兵
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