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搜索资源列表

  1. KeilC51

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  2. 本文档包括单片机系统中常用到的时钟中断、通讯及键盘扫描等模块(见所附源程序)的说明。这些模块使用前后台系统模型。为达到最大的灵活性, 需要在用户工程中定义config.h文件, 在其中定义各模块可选参数的设置,而不是直接更改源代码。-this document, including SCM system clock used to the interruption communications and keyboard scanning modules (see accompanying sou
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2008-10-13
    • 文件大小:15.47kb
    • 提供者:yanyan
  1. VerilogHDLchinapub

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  2. Verilog HDL硬件描述语言 01简介.PDF 02HDL指南.PDF 03语言要素.PDF 04表达式.PDF 05门电平模型化.PDF 06用户定义原语.PDF 07数据流模型化.PDF 08行为建模.PDF 09结构建模.PDF 10其它论题.PDF 11验证.PDF 12建模实例.PDF 13语法参考.PDF-Verilog HDL Hardware Descr iption Language Introduction 01. P
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:4.61mb
    • 提供者:
  1. fft-ifft

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  2. 用C语言实现了基2 DIT-FFT、DIF-FFT、DIT-IFFT和DIF-IFFT,而且运算点数可以自己设定,在vs2005下运行通过-2-based DIT-FFT、DIF-FFT、DIT-IFFT和DIF-IFFT with user-defined processing points are implemented using C, which has been run successfully in VS 2005.
  3. 所属分类:DSP program

    • 发布日期:2017-03-23
    • 文件大小:353.05kb
    • 提供者:燕潇云
  1. DiskRW

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  2. Usage: dumprom [options] imagefile [offset [imagefile offset ...]] -d <dirpath> - save found files/modules to this path -v - verbose : print alignment, struct contents -q - quiet : don t print anything -n - don t use negative rva fi
  3. 所属分类:Windows CE

    • 发布日期:2017-03-21
    • 文件大小:399.53kb
    • 提供者:x86
  1. Verilog_UDP

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  2. 辛辛苦苦找到的UDP的资料,在verilog中UDP指的是用户定义的原语。比如说大家有时候会见到“primitive...table...endtable...endendprimitive”这样的代码段,在书上只能找到大概的解释。到网上查的话又老是跟TCP/IP的UDP冲突。所以特地搜集到了这个东西,希望能帮助大家解决“用户原语”相关的问题。-UDP hard to find the information in verilog in the UDP refers to the user-de
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:122.7kb
    • 提供者:龙也
  1. J1939

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  2. OBD II 汽车故障诊断之J1939源代码,适用于PIC18系列单片机,稍作改动可用于其它类型单片机-Module Features • Supports user-defined setup of CAN and ECAN parameters like baud rate, maximum message size, number of reception/transmission buffers. • Incorporates interrupt-dr
  3. 所属分类:SCM

    • 发布日期:2017-03-22
    • 文件大小:141.7kb
    • 提供者:冬天
  1. 20081129464173846

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  2. 介绍Verilog HDL, 内容包括: – Verilog应用 – Verilog语言的构成元素 – 结构级描述及仿真 – 行为级描述及仿真 – 延时的特点及说明 – 介绍Verilog testbench • 激励和控制和描述 • 结果的产生及验证 – 任务task及函数function – 用户定义的基本单元(primitive) – 可综合的Verilog描述风格-Introduced the Verilog HDL, in
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:727.5kb
    • 提供者:卢志文
  1. dvoraksip

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  2. window mobile 输入应用,支持用户自定义功能,支持多种语言,window mobile sdk6下定的!@-The soft input panel (SIP) was designed to support user-defined input mechanisms. By default, it includes a standard keyboard, a block recognizer, and letter recognizer. This sa
  3. 所属分类:Windows CE

    • 发布日期:2017-03-29
    • 文件大小:30.15kb
    • 提供者:ljt
  1. SPCE061_SPR4096

    0下载:
  2. 本源码为凌阳61开发板的使用例程,主要针对SPR4096模块的应用。本源码压缩包含有一个模块PDF说明文档。 SPCE061A对SPR4096进行操作。先把SPR4096格式化,然后往其中写入M_NUMBER个Byte的数据(M_NUMBER的大小由用户自己定义),接着把这些数据读出来放在数组uiByteBuffer中;下一步是对刚才写入数据所在的扇区进行扇区擦除,往其中写入M_NUMBER个Word的数据,接着把这些数据读出来放在数组uiWordBuffer中。程序运行后,可以在IDE的W
  3. 所属分类:SCM

    • 发布日期:2017-03-31
    • 文件大小:296.15kb
    • 提供者:huangshengqun
  1. pc_remote_control

    0下载:
  2. The convenience of selecting TV channels using your remote and then pointing the same remote to your Computer so that you can control the whole system using the single remote control. The Following functions can be done with PC Remote control. All Nu
  3. 所属分类:Other Embeded program

    • 发布日期:2017-03-29
    • 文件大小:272.84kb
    • 提供者:Binu
  1. verilog_tutorial

    0下载:
  2. Chapter 1 Introduction Chapter 2 History of Verilog Chapter 3 Design and Tool Flow Chapter 4 My First Program in Verilog Chapter 5 Verilog HDL Syntax and Semantics Chapter 6 Gate Level Modeling Chapter 7 User Defined Primitives Chapter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:755.11kb
    • 提供者:zhangyung
  1. Widgetkeyboard

    1下载:
  2. 声明此文件不是原创 qt 做的一个屏幕虚拟键盘 自己做了一个界面,模拟键盘, 将自定义的键盘按键,映射成真实键盘按键 上面还有一些bug, 不过个人觉得可以参考其思想-the project file is not myself the virtual keyboard is made in qt. the ui is user defined ui, map the user buttons to the truth keyboar
  3. 所属分类:SCM

    • 发布日期:2017-04-04
    • 文件大小:28.75kb
    • 提供者:many_many
  1. VHDL

    0下载:
  2. 介绍Verilog HDL, 内容包括:Verilog应用,Verilog语言的构成元素,结构级描述及仿真 ,行为级描述及仿真,延时的特点及说明 介绍Verilog testbench,激励和控制和描述 结果的产生及验证,任务task及函数function 用户定义的基本单元(primitive),可综合的Verilog描述风格等-Introduction Verilog HDL, including: Verilog applications, Verilog language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:1.45mb
    • 提供者:shirley
  1. fir_compiler

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  2. FIR编译器。自动生成具有用户自定参数的FIR滤波器。 在 matlab里面设计滤波器,matlab里面设计输入字长。生成的rtl代码是该文件的头部有位宽宏定义,可以自行查阅。 -FIR Compiler. Automatically generate a user-defined parameters of FIR filters. Design a filter inside the matlab, matlab which design input word length. Rtl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:2.04mb
    • 提供者:秋田
  1. data-acquisition-program-

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  2.  数据采集,是指从传感器和其它待测设备等模拟和数字被测单元中自动采集信息的过程。数据采集系统是数据采集结合基于计算机的测量软硬件产品来实现灵活的、用户自定义的测量系统。此处基于汇编语言在AT89C51单片机上实现数据采集。-Data acquisition, is tested from the sensors and other analog and digital test equipment to automatically collect information unit process
  3. 所属分类:SCM

    • 发布日期:2017-03-26
    • 文件大小:4.05kb
    • 提供者:杨洪骞
  1. System_Demons

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  2. 0.最简单的SystemC程序:hello, world. 1.用SystemC实现D触发器的例子,同时也演示了如何生成VCD波形文件。 2.用SystemC实现同步FIFO的例子。这个FIFO是从同文件夹的fifo.v(verilog代码)翻译过来的。 3.如何在SystemC中实现延时(类似verilog中的#time)的例子。 4.SystemC文档《User Guide》中的例子。注意和文挡中稍有不同的是修改了packet.h文件,重载了=和<<操作符。这其实
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:520.39kb
    • 提供者:sdd
  1. udfconfig

    1下载:
  2. 此程序是CFD中用户自定义中的定义速度变化的程序,输入到Fluent中控制入口速度-This program is a change of user-defined in the definition of speed in CFD program, the input to control the inlet velocity in Fluent
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2013-05-10
    • 文件大小:1.28kb
    • 提供者:wangkingtang
  1. Electronic-code-lock-with-user-defined-password-u

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  2. CHuong trinh Pass su dung 89C51
  3. 所属分类:Other Embeded program

    • 发布日期:2017-03-27
    • 文件大小:89.51kb
    • 提供者:hao
  1. user_boil

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  2. Fluent数值模拟软件关于动网格的用户自定义函数。-Fluent numerical simulation software on the dynamic grid user-defined functions.
  3. 所属分类:微处理器(ARM/PowerPC等)

    • 发布日期:2015-06-26
    • 文件大小:1kb
    • 提供者:陈风
  1. test_myip

    0下载:
  2. xilinx EDK virtex II xc2vp30 用户自定义IP核led灯实验-the xilinx EDK virtex II xc2vp30 user-defined IP core led light experiment
  3. 所属分类:ARM-PowerPC-ColdFire-MIPS

    • 发布日期:2017-12-01
    • 文件大小:2.51mb
    • 提供者:yueqi
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