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hdb3
- HDB3码的VHDL实现 共三个模块：插入V、插入B以及单双极性变换
hdb3 decoder
- 我上期做的VHDL设计方案，用于在FPGA或CPLD中实现HDB3的编码-I do view on the VHDL design options for the CPLD or FPGA to achieve HDB3 code
hdb3
- vhdl语言实现的hdb3编解码的功能，已完成调试。-vhdl
hdb3
- 实现了用vhdl语言完成在编码过程中的插B功能，-vhdl hdb3
HDB3encoder
- 数字基带信号的传输是数字通信系统的重要组成部分。在数字通信中，有些场合可不经过载波调制和解调过程，而对基带信号进行直接传输。采用AMI码的信号交替反转，有可能出现四连零现象，这不利于接收端的定时信号提取。而HDB3码因其无直流成份、低频成份少和连0个数最多不超过三个等特点，而对定时信号的恢复十分有利，并已成为CCITT协会推荐使用的基带传输码型之一。为此，本文利用VHDL语言对数据传输系统中的HDB3编码器进行了设计。-Digital baseband signal transmission i
HDB3
- VHDL语言编写的HDB3码的编译码模块-VHDL language code HDB3 codec module
HDB3_coder
- 实现了将64K低速NRZ码复接成2.048M高速HDB3码及其解复接过程，同时还用同步状态机剔除假同步和假失步的状态 -Achieved the 64K low-speed NRZ code 2.048M into high-speed multiplexing and demultiplexing HDB3 code then the process also removed using false synchronous state machine synchronization and f
HDB3
- HDB3编码器与译码 HDB3编码器与译码-HDB3 encoder and decoder
vhdl_hdb3
- a VHDL source code on HDB3 encoder realaized in FPGA/CPLD
hdb3_decode
- hdb3码的编码及解码代码，包括模块连接。-hdb3 code encoding and decoding code, including modules.
hdb3_codedecode
- 用VERILOG实现的，hdb3编码器和解码器，经过前仿真和后仿真成功-Achieved with the VERILOG, hdb3 encoder and decoder, after a successful pre-simulation and post simulation
HDB3
- HDB3编解码过程，本代码用vhdl语言书写，重现了HDB3编解码的详细过程。相信对广大写硬件语言的朋友有好处-HDB3 code and decode
VHDL
- 基于 VHDL平台 的NRZ码 转HDB3码 程序-NRZ-> HDB3 coding based on VHDL
HDB3(2)
- 利用vhdl编写 实现数字基带传输HDB3码解码程序-vhdl hdb3 decode
HDB3
- 基于FPGA的HDB3编码 利用VHDL实现的源码-The HDB3 code based on FPGA implementation using VHDL source code
HDB3
- hdb3键盘接口VHDL程序，经过严格仿真，很有参考价值。-HDB3 VHDL keyboard interface program, after a rigorous simulation, of great reference value.
HDB3-VHDL-code
- HDB3的VHDL语言描述，注释在文件内-HDB3 source code in VHDL
HDB3
- 按照要求对“数字基带信号HDB3译码器设计与建模”进行逻辑分析，了解HDB3译码器译码原理，了解各模块电路的逻辑功能，设计通信系统框图，画出实现电路原理图，编写VHDL语言程序，上机调试、仿真，记录实验结果波形，对实验结果进行分析。(In accordance with the requirements of the logical analysis of the design and modeling of the digital baseband signal HDB3 decoder, H
EDA
- 本设计是在Quartus ii开发环境下采用VHDL语言实现的AMI/HDB3编码器课程设计。(This design is a course design of AMI / HDB3 encoder implemented by VHDL language in the development environment of Quartus II.)