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  1. key_display

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  2. 秒表 verilog 程序非常适合刚接触 vreilog语言的人学习-Stopwatch verilog program is ideal for people new to vreilog language learning

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-03
    • 文件大小：365.03kb
    • 提供者：张江

  1. DianZiZhong

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  2. 智能数字钟完整Verilog HDL代码，数码管显示，三个按键控制，能完整显示年月日和时分秒及对其的调整设置，能设置闹钟，有秒表，有10秒倒计时-Alarmclock Verilog HDL

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-16
    • 文件大小：10.38kb
    • 提供者：豪哥
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