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  1. OpenCorespcicore

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  2. PCI IP核功能实现,符合V2.2协议-realize pci function
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1.15mb
    • 提供者:sophie
  1. Ms32pci

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  2. PCI-ip硬件描述语言-开源的,可以做参考设计,如果需要的话,-This models are written in VHDL! Author is Ovidiu Lupas! MASTER model generates PCI compliant signals checks Target signal compliance with PCI checks data received from Target for correctness generates
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:6.08kb
    • 提供者:kity
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