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搜索资源列表

  1. dds_fpga

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  2. DDS在现在运用月来越广泛,在相对带宽、频率转换时间、相位连续性、正交输出、高分辨力以及集成化等方面都远远超过了传统频率合成技术所能达到的水平,为系统提供了优于模拟信号源的性能。利用DDS技术可以很方便地实现多种信号。在FPGA上实现的DDS-DDS now to the use of more extensive relative bandwidth, frequency conversion time, phase continuity, quadrature output, high-re
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:175.86kb
    • 提供者:孙洪亮
  1. digital-quadrature-down-converter

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  2. 基于FPGA的数字正交下变频器设计,在ALTERA的DE2开发板上设计一个多相滤波结构数字正交变换器。其中多相滤波模块是最关键模块,该模块将64阶滤波器的系数分成奇偶两路,并通过VHDL常数的方式存储在模块内部。这些常数是通过在MATLAB中调用FDATool,根据滤波器的参数要求来生成的。这些浮点格式的滤波器系数还需要在MATLAB中计算成二进制补码的形式,才可以存储在模块中。-FPGA-based digital quadrature down-converter design, ALTER
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-23
    • 文件大小:7.07mb
    • 提供者:joey
  1. FPGA_vhdl_mode

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  2. 基于FPGA的数字化正交解调接收机最优设计,利用vhdl进行调制解调。-Optimal design of FPGA-based digital quadrature demodulation receiver, vhdl modem.
  3. 所属分类:software engineering

    • 发布日期:2017-04-16
    • 文件大小:286.68kb
    • 提供者:ACER
  1. IF-demodulator-on-FPGA

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  2. 数字中频正交解调器及其FPGA实现,介绍了数字数字中频正交解调实现原理和FPGA实现方案-The digital IF quadrature demodulator its FPGA implementation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-05
    • 文件大小:547.02kb
    • 提供者:沧海一粟
  1. Digital-IF-quadrature-sampling

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  2. 中频信号IQ两路正交采样的算法以及FPGA实现-IQ two orthogonal IF signal sampling algorithm and FPGA implementation
  3. 所属分类:Communication

    • 发布日期:2017-04-02
    • 文件大小:512.37kb
    • 提供者:cheng
  1. Quadrature-modulate-design

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  2. FPGA正交调制设计Verilog程序代码-FPGA Orthogonal modulation design procedure code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-10-02
    • 文件大小:10kb
    • 提供者:吴汉
  1. Quadrature_MACx42_AvalonSt_Input v1.0

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  2. This module does Complex MAC based on Altera Stratix 2 DSP Blocks.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-10
    • 文件大小:85kb
    • 提供者:serg_86
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