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搜索资源列表

  1. Viterbi_RAKE

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  2. 这是一篇介绍用verilog语言实现viterbi译码和rake接收机的文章,实用性很强的,在这里也感谢这篇文章的作着
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:8.43mb
    • 提供者:骆军
  1. Rake_Receiver

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  2. 用Verilog HDL语言实现一个Rake接收机的最大比合并准则,其中3路输入数据是并行相关输出-Verilog HDL language with a Rake receiver maximum ratio combining criteria, of which 3 related to the parallel input data is output
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:929byte
    • 提供者:张茂磊
  1. hardware-rake_mrc1

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  2. 采用硬件描述语言verilog进行RAKE MRC变换的实现的代码-Using hardware descr iption languages Verilog implementation ofRAKE MRC converter code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1011byte
    • 提供者:何晨光
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