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搜索资源 - static timing analysis
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Altera Quartusii静态时序分析（Static Timing Analysis）基础及应用
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technology mapping and static timing analysis
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静态时序分析设计的经典教程书籍
全面，权威的讲解，丰富的内容举例-Static timing analysis tutorial books classic design a comprehensive, authoritative presentation, rich content, for example
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good material about Static Timing Analysis primetime and Formal verificationformality
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静态时序分析（Static Timing Analysis简称STA）经由完整的分析方式判断IC是否能够在使用者的时序环境下正常工作，对确保IC质量之课题，提供一个不错的解决方案。然而，对于许多IC设计者而言，STA是个既熟悉却又陌生的名词。本文将力求以简单叙述及图例说明的方式，对STA的基础概念及其在IC设计流程中的应用做详尽的介绍。-Static timing analysis (Static Timing Analysis referred to as STA) through a com
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本文主要对硬件电路的静态时序分析与逻辑设计，概念，工具使用等方法进行介绍说明-In this paper, the hardware circuits static timing analysis and logic design, concepts, tools and methods of use of an introductory statement
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Static Timing Analysis is a method of computing the expected timing of a digital circuit without requiring simulation.
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静态时序分析100以太网控制芯片的应用，对用以太网的朋友很有帮助。-Static timing analysis of 100 Ethernet control chip, a friend of the use of Ethernet helpful.
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EDA simulation tool of static timing analysis
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华为_静态时序分析与逻辑设计，FPGA时序分析友-Huawei _ static timing analysis and logic design, FPGA timing analysis of Friends
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Static Timing Analysis for Nanometer Designs, ASIC 静态时序分析非常有用的书籍-Static Timing Analysis for Nanometer Designs, ASIC design
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该使用指南适用于初次使用ispLEVER 软件或者不常使用该软件的工程设计人员，它可以帮助你去了解
不同的处理过程，使用各种工具，以及熟悉ispLEVER 产生的各种报告。在进行下一步时，可以准备一
个设计，以此去了解设计的仿真，功耗的计算，静态时序分析，以及以时序驱动的布局和布线，检查由
软件输出的报告等。以此设计为例，你可以练习约束设计的输入，输出信号以及这些信号管脚的分配去
满足系统要求。也可以修改约束条件，达到最佳地利用LatticeEC 的结构和资源，同时实现高性能。该
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华为内部资料，内容为静态时序与逻辑分析，对IC前端设计有用-Huawei internal information content of static timing analysis and logic, the IC front-end design useful for
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《华为静态时序分析与逻辑设计》《华为静态时序分析与逻辑设计》-Huawei static timing analysis and logic designHuawei static timing analysis and logic design
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华为内部资料，整理分享给大家，内容如下：
1.Proverilog编码规范(草案)
2.华为_Verilog HDL电路设计指导书
3.华为内部培训资料linux 基础
4.华为同步电路设计规范
5.华为-硬件工程师
6.静态时序分析与逻辑设计-
Huawei internal books, organize to share to you, reads as follows:
1.Proverilog coding standard (draft)
2.th
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文献包含PT的时序分析方法说明：
PrimeTime is a full-chip, gate-level static timing analysis tool targeted for complex,
multimillion-gate designs. It offers an unsurpassed combination of speed, capacity, ease of
use, and compatibility with industry-standard da
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关于数字逻辑设计中静态时序分析和布局布线相关的资料。-Static timing analysis in digital logic design and layout information.
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static timing analysis and timing paths
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PT静态时序分析STA脚本，包含一般的STA分析，功耗，SI分析-PT Static Timing Analysis STA scr ipt that contains general STA analysis, power consumption, SI analysis
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静态时序分析，有很详细的例子和图标说明，对于FPGA工程师非常有用，对于IC工程师也非常有用！(Static timing analysis, there are very detailed examples and icon descr iptions.)
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