文件名称:jicun
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所属分类：
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- 上传时间：2012-11-16
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32位32个寄存器组程序设计，用vhdl语言-module registers071221049
(
input [4:0]s1,s2,
input [4:0] wd,
input [31:0] data,
input wre, clk,
input he,hc,le,lc,
output [31:0] out1,
output [31:0] out2
)
(
input [4:0]s1,s2,
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input wre, clk,
input he,hc,le,lc,
output [31:0] out1,
output [31:0] out2
)
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