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文件名称:PLL

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    374.57kb
  • 已下载：
    0次
  • 提 供 者：
    Yo***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

基于EP2C8的锁相环倍频文件 原来时钟为25Mhz 倍频为100Mhz-File the original clock of the EP2C8 the phase locked loop frequency multiplier 25Mhz for 100Mhz
相关搜索： EP2C8

(系统自动生成,下载前可以参看下载内容)

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TEST_3_24_PLL - 副本 (2)/db/logic_util_heursitic.dat
TEST_3_24_PLL - 副本 (2)/db/PLL.(0).cnf.cdb
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TEST_3_24_PLL - 副本 (2)/db
TEST_3_24_PLL - 副本 (2)/grey

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