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文件名称:17-Clock

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    79.63kb
  • 已下载：
    0次
  • 提 供 者：
    h****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

这是一个成功的电子钟VHDL和Verilog源代码，已在DH－33001开发板上调试成功。-This is a successful electronic clock VHDL and Verilog source code, in the DH-33 001 development board debugging.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

17 Clock/BCD.v
17 Clock/Clock.asm.rpt
17 Clock/Clock.bsf
17 Clock/Clock.cdf
17 Clock/Clock.done
17 Clock/Clock.fit.eqn
17 Clock/Clock.fit.rpt
17 Clock/Clock.fit.summary
17 Clock/Clock.flow.rpt
17 Clock/Clock.map.eqn
17 Clock/Clock.map.rpt
17 Clock/Clock.map.summary
17 Clock/Clock.pin
17 Clock/Clock.pof
17 Clock/Clock.qpf
17 Clock/Clock.qsf
17 Clock/Clock.qws
17 Clock/Clock.sof
17 Clock/Clock.tan.rpt
17 Clock/Clock.tan.summary
17 Clock/clock.v
17 Clock/Clock.vhd
17 Clock/Clock.vwf
17 Clock/Clock_assignment_defaults.qdf
17 Clock/cmp_state.ini
17 Clock/db/add_sub_5nh.tdf
17 Clock/db/add_sub_8nh.tdf
17 Clock/db/Clock(0).cnf.cdb
17 Clock/db/Clock(0).cnf.hdb
17 Clock/db/Clock(1).cnf.cdb
17 Clock/db/Clock(1).cnf.hdb
17 Clock/db/Clock.db_info
17 Clock/db/Clock.eco.cdb
17 Clock/db/Clock.sld_design_entry.sci
17 Clock/db/Clock_cmp.qrpt
17 Clock/db/Clock_hier_info
17 Clock/db/Clock_syn_hier_info
17 Clock/db
17 Clock

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