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文件名称:QPSK_fpga

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    1.84mb
  • 已下载：
    1次
  • 提 供 者：
    vincen******
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

QPSK调制和解调的FPGA实现，包括伪码生成等模块-QPSK modulation and demodulation of the FPGA, including the pseudo-code generation modules
(系统自动生成,下载前可以参看下载内容)

下载文件列表

chenyu_fpga/chenyu_fpga.asm.rpt
chenyu_fpga/chenyu_fpga.done
chenyu_fpga/chenyu_fpga.eda.rpt
chenyu_fpga/chenyu_fpga.fit.rpt
chenyu_fpga/chenyu_fpga.fit.smsg
chenyu_fpga/chenyu_fpga.fit.summary
chenyu_fpga/chenyu_fpga.flow.rpt
chenyu_fpga/chenyu_fpga.map.rpt
chenyu_fpga/chenyu_fpga.map.summary
chenyu_fpga/chenyu_fpga.pin
chenyu_fpga/chenyu_fpga.pof
chenyu_fpga/chenyu_fpga.qpf
chenyu_fpga/chenyu_fpga.qsf
chenyu_fpga/chenyu_fpga.sof
chenyu_fpga/chenyu_fpga.tan.rpt
chenyu_fpga/chenyu_fpga.v
chenyu_fpga/chenyu_fpga.v.bak
chenyu_fpga/chenyu_fpga_nativelink_simulation.rpt
chenyu_fpga/counter_9.v
chenyu_fpga/counter_9.v.bak
chenyu_fpga/db/chenyu_fpga.(0).cnf.cdb
chenyu_fpga/db/chenyu_fpga.(0).cnf.hdb
chenyu_fpga/db/chenyu_fpga.(1).cnf.cdb
chenyu_fpga/db/chenyu_fpga.(1).cnf.hdb
chenyu_fpga/db/chenyu_fpga.(2).cnf.cdb
chenyu_fpga/db/chenyu_fpga.(2).cnf.hdb
chenyu_fpga/db/chenyu_fpga.(3).cnf.cdb
chenyu_fpga/db/chenyu_fpga.(3).cnf.hdb
chenyu_fpga/db/chenyu_fpga.(4).cnf.cdb
chenyu_fpga/db/chenyu_fpga.(4).cnf.hdb
chenyu_fpga/db/chenyu_fpga.(5).cnf.cdb
chenyu_fpga/db/chenyu_fpga.(5).cnf.hdb
chenyu_fpga/db/chenyu_fpga.(6).cnf.cdb
chenyu_fpga/db/chenyu_fpga.(6).cnf.hdb
chenyu_fpga/db/chenyu_fpga.asm.qmsg
chenyu_fpga/db/chenyu_fpga.asm.rdb
chenyu_fpga/db/chenyu_fpga.asm_labs.ddb
chenyu_fpga/db/chenyu_fpga.cbx.xml
chenyu_fpga/db/chenyu_fpga.cmp.bpm
chenyu_fpga/db/chenyu_fpga.cmp.cdb
chenyu_fpga/db/chenyu_fpga.cmp.ecobp
chenyu_fpga/db/chenyu_fpga.cmp.hdb
chenyu_fpga/db/chenyu_fpga.cmp.kpt
chenyu_fpga/db/chenyu_fpga.cmp.logdb
chenyu_fpga/db/chenyu_fpga.cmp.rdb
chenyu_fpga/db/chenyu_fpga.cmp.tdb
chenyu_fpga/db/chenyu_fpga.cmp0.ddb
chenyu_fpga/db/chenyu_fpga.cmp_merge.kpt
chenyu_fpga/db/chenyu_fpga.db_info
chenyu_fpga/db/chenyu_fpga.eco.cdb
chenyu_fpga/db/chenyu_fpga.eda.qmsg
chenyu_fpga/db/chenyu_fpga.fit.qmsg
chenyu_fpga/db/chenyu_fpga.hier_info
chenyu_fpga/db/chenyu_fpga.hif
chenyu_fpga/db/chenyu_fpga.lpc.html
chenyu_fpga/db/chenyu_fpga.lpc.rdb
chenyu_fpga/db/chenyu_fpga.lpc.txt
chenyu_fpga/db/chenyu_fpga.map.bpm
chenyu_fpga/db/chenyu_fpga.map.cdb
chenyu_fpga/db/chenyu_fpga.map.ecobp
chenyu_fpga/db/chenyu_fpga.map.hdb
chenyu_fpga/db/chenyu_fpga.map.kpt
chenyu_fpga/db/chenyu_fpga.map.logdb
chenyu_fpga/db/chenyu_fpga.map.qmsg
chenyu_fpga/db/chenyu_fpga.map_bb.cdb
chenyu_fpga/db/chenyu_fpga.map_bb.hdb
chenyu_fpga/db/chenyu_fpga.map_bb.logdb
chenyu_fpga/db/chenyu_fpga.pre_map.cdb
chenyu_fpga/db/chenyu_fpga.pre_map.hdb
chenyu_fpga/db/chenyu_fpga.rtlv.hdb
chenyu_fpga/db/chenyu_fpga.rtlv_sg.cdb
chenyu_fpga/db/chenyu_fpga.rtlv_sg_swap.cdb
chenyu_fpga/db/chenyu_fpga.sgdiff.cdb
chenyu_fpga/db/chenyu_fpga.sgdiff.hdb
chenyu_fpga/db/chenyu_fpga.sld_design_entry.sci
chenyu_fpga/db/chenyu_fpga.sld_design_entry_dsc.sci
chenyu_fpga/db/chenyu_fpga.smart_action.txt
chenyu_fpga/db/chenyu_fpga.syn_hier_info
chenyu_fpga/db/chenyu_fpga.tan.qmsg
chenyu_fpga/db/chenyu_fpga.tis_db_list.ddb
chenyu_fpga/db/logic_util_heursitic.dat
chenyu_fpga/db/prev_cmp_chenyu_fpga.asm.qmsg
chenyu_fpga/db/prev_cmp_chenyu_fpga.eda.qmsg
chenyu_fpga/db/prev_cmp_chenyu_fpga.fit.qmsg
chenyu_fpga/db/prev_cmp_chenyu_fpga.map.qmsg
chenyu_fpga/db/prev_cmp_chenyu_fpga.qmsg
chenyu_fpga/db/prev_cmp_chenyu_fpga.tan.qmsg
chenyu_fpga/div_15.v
chenyu_fpga/div_15.v.bak
chenyu_fpga/incremental_db/compiled_partitions/chenyu_fpga.root_partition.cmp.cdb
chenyu_fpga/incremental_db/compiled_partitions/chenyu_fpga.root_partition.cmp.dfp
chenyu_fpga/incremental_db/compiled_partitions/chenyu_fpga.root_partition.cmp.hdb
chenyu_fpga/incremental_db/compiled_partitions/chenyu_fpga.root_partition.cmp.kpt
chenyu_fpga/incremental_db/compiled_partitions/chenyu_fpga.root_partition.cmp.logdb
chenyu_fpga/incremental_db/compiled_partitions/chenyu_fpga.root_partition.cmp.rcfdb
chenyu_fpga/incremental_db/compiled_partitions/chenyu_fpga.root_partition.cmp.re.rcfdb
chenyu_fpga/incremental_db/compiled_partitions/chenyu_fpga.root_partition.map.cdb
chenyu_fpga/incremental_db/compiled_partitions/chenyu_fpga.root_partition.map.dpi
chenyu_fpga/incremental_db/compiled_partitions/chenyu_fpga.root_partition.map.hdb
chenyu_fpga/incremental_db/compiled_partitions/chenyu_fpga.root_partition.map.kpt
chenyu_fpga/incremental_db/README
chenyu_fpga/pr_code_gen.v
chenyu_fpga/pr_code_gen.v.bak
chenyu_fpga/QPSK_C.v
chenyu_fpga/QPSK_C.v.bak
chenyu_fpga/QPSK_IQ_demodulate.v
chenyu_fpga/QPSK_IQ_demodulate.v.bak
chenyu_fpga/qpsk_iq_modulate.v
chenyu_fpga/qpsk_iq_modulate.v.bak
chenyu_fpga/simulation/modelsim/chenyu_fpga.sft
chenyu_fpga/simulation/modelsim/chenyu_fpga.vo
chenyu_fpga/simulation/modelsim/chenyu_fpga.vt
chenyu_fpga/simulation/modelsim/chenyu_fpga.vt.bak
chenyu_fpga/simulation/modelsim/chenyu_fpga_modelsim.xrf
chenyu_fpga/simulation/modelsim/chenyu_fpga_run_msim_rtl_verilog.do
chenyu_fpga/simulation/modelsim/chenyu_fpga_run_msim_rtl_verilog.do.bak
chenyu_fpga/simulation/modelsim/chenyu_fpga_run_msim_rtl_verilog.do.bak1
chenyu_fpga/simulation/modelsim/chenyu_fpga_run_msim_rtl_verilog.do.bak10
chenyu_fpga/simulation/modelsim/chenyu_fpga_run_msim_rtl_verilog.do.bak11
chenyu_fpga/simulation/modelsim/chenyu_fpga_run_msim_rtl_verilog.do.bak2
chen

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