文件名称:a-simple-state-machine
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- 上传时间:2012-11-16
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简易状态机 verilog实现的简单状态机,全工程不错的 典型历程 值得学习入门很好的实验例程-Simple state machine verilog achieve a simple state machine, the typical course of the whole works good deserves learning entry good experimental routines
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简单状态机/
简单状态机/.sopc_builder/
简单状态机/.sopc_builder/install.ptf
简单状态机/.xhdl3.xref
简单状态机/atom_netlists/
简单状态机/atom_netlists/state_machine.vqm
简单状态机/cmp_state.ini
简单状态机/db/
简单状态机/db/add_sub_5ph.tdf
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简单状态机/db/state_machine.eco.cdb
简单状态机/db/state_machine.fit.qmsg
简单状态机/db/state_machine.hier_info
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简单状态机/db/state_machine.map.qmsg
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简单状态机/db/state_machine.rtlv_sg_swap.cdb
简单状态机/db/state_machine.sgdiff.cdb
简单状态机/db/state_machine.sgdiff.hdb
简单状态机/db/state_machine.signalprobe.cdb
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简单状态机/db/state_machine.sld_design_entry_dsc.sci
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简单状态机/db/state_machine_cmp.qrpt
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