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文件名称:33-square-root

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
  • 上传时间：
    2013-01-12
  • 文件大小：
    13.25kb
  • 已下载：
    0次
  • 提 供 者：
    王****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

使用VHDL语言实现33位平方根进位选择加法器，能满足在500M时钟下正确工作，使用DB测试，并通过前仿。-Using VHDL language 33 square root carry select adder, to meet in the 500M clock work correctly, use the DB test, and through imitation.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

33 square root/test.vhd
33 square root/adder.vhd
33 square root/fulladd.vhd
33 square root/nadd.vhd
33 square root/netlist.sdf
33 square root/netlist.vhd
33 square root

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