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文件名称:eetop.cn_emif_brg

  • 所属分类：
    VHDL编程
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2013-03-16
  • 文件大小：
    4.09kb
  • 已下载：
    2次
  • 提 供 者：
    g****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

fpga与DSP通过emif接口通信，fpga内部通过fifo进行数据缓存-fpga with the DSP through emif interface communication, fpga internal data cache by fifo
(系统自动生成,下载前可以参看下载内容)

下载文件列表

emif_brg/emif_brg.v
emif_brg/emif_sim.v
emif_brg/fifo_out.v
emif_brg

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