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文件名称:plj.FPGA

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [C/C++] [源码]
  • 上传时间：
    2015-06-14
  • 文件大小：
    8.85mb
  • 已下载：
    0次
  • 提 供 者：
    刘***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

本频率计基于CPLD/FPGA实现。　50MHZ标准频率为CPLD内部时钟信号，被测方波为信号发生器产生的方波信号，显示电路由TTL芯片及七段数码管组成的电路，自校正输出由CPLD输出已知频率的测试方波信号，可将其输入至测试端口，进行系统精度校正。　-The frequency meter based on CPLD/FPGA implementation. 50MHZ standard CPLD internal clock signal frequency, square-wave test signal is a square wave signal generator, the display circuit circuit TTL chip and composed of seven segments, self-correction output　the CPLD output a known frequency square wave test signals can be input to the test port for system accuracy correction.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

plj上FPGA板终结版/
plj上FPGA板终结版/.Xil-PlanAhead-1260-WIN7U-20130804N/
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