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文件名称:jietiao

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [Windows] [程序]
  • 上传时间：
    2017-05-17
  • 文件大小：
    82.13kb
  • 已下载：
    0次
  • 提 供 者：
    陈***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
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如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

基于verilog HDL的数字正交（调制）FPGA实现，仿真结果验证正确。vivado 2014-　U57FA　u4E8Everilog HDL　u7684　u6570　u5B57　u6B63　u4EA4　uFF08　u8C03　u5236　uFF09FPGA　u5B9E　u73B0　uFF0C　u4EFF　u771F　u7ED3　u679C　u9A8C　u8BC1　u6B63　u786E　u3002vivado 2014
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jietiao/
jietiao/.Xil/
jietiao/project_3.cache/
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jietiao/project_3.cache/wt/
jietiao/project_3.cache/wt/synthesis.wdf
jietiao/project_3.cache/wt/webtalk_pa.xml
jietiao/project_3.cache/wt/xsim.wdf
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jietiao/project_3.sim/sim_1/
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jietiao/project_3.sim/sim_1/behav/.Xil/
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jietiao/project_3.sim/sim_1/behav/webtalk.log
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jietiao/project_3.sim/sim_1/behav/webtalk_8444.backup.log
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jietiao/project_3.sim/sim_1/behav/xsim.dir/test_behav/
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