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文件名称:FIFO_RAM

  • 所属分类：
    VHDL/FPGA/Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2017-07-06
  • 文件大小：
    3kb
  • 已下载：
    0次
  • 提 供 者：
    炜仔m***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

同步FIFO_RAM的设计及其testbench(8 bit SYN FIFO module fifo_v(clk,rst,wen,ren,full,empty,data,q);)
相关搜索： verilog testbench

(系统自动生成,下载前可以参看下载内容)

下载文件列表

FIFO_RAM\fifo_test.v
FIFO_RAM\fifo_test.v.bak
FIFO_RAM\fifo_v.v
FIFO_RAM\fifo_v.v.bak
FIFO_RAM\syn_tb.v
FIFO_RAM\syn_tb.v.bak
FIFO_RAM

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