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文件名称:statemachine

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
  • 上传时间：
    2012-10-26
  • 文件大小：
    149.08kb
  • 已下载：
    0次
  • 提 供 者：
    p*****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

用VHDL实现的有限状态机，还有modelsim仿真文件，及仿真结果-VHDL implementation using finite state machine, there modelsim simulation file, and the simulation results
相关搜索： 有限状态机

(系统自动生成,下载前可以参看下载内容)

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hw1.jpg
hw1_2.jpg
StateMachine.vhd
StateMachine_tb.vhd

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