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  1. ce_crtdbg

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  2. This code detects memory leaks in embedded VC++ almost the same way crtdbg does in VC++. At the end of program execution it will display in the debug window if there were any memory leaks and how the memory looks so you can identify where your memory
  3. 所属分类:Windows CE

    • 发布日期:2008-10-13
    • 文件大小:2.52kb
    • 提供者:杨久敏
  1. serial_program_for_51

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  2. 很完整的51串口程序 包括如下: 串口中断服务程序,仅需做简单调用即可完成串口输入输出的处理 出入均设有缓冲区,大小可任意设置。 可供使用的函数名: char getbyte(void) 从接收缓冲区取一个byte,如不想等待则在调用前检测inbufsign是否为1。 getline(char idata *line, unsigned char n) 获取一行数据回车结束,必须定义最大输入字符数 putbyte(char c) 放入一个字节到发送缓冲区 putb
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2008-10-13
    • 文件大小:3.54kb
    • 提供者:eacho
  1. YCbCrRGB

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  2. TMS320c6000系列DSP做图像处理的应用举例,图象颜色模式转换,从RGB到Y Cr Cb
  3. 所属分类:DSP编程

    • 发布日期:2008-10-13
    • 文件大小:22.01kb
    • 提供者:ming
  1. IH_XC836_6G

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  2. 2010年最新版本电动车控制器xc836方案,包括所有功能,BK,CR,TA,TB,P1-P3-2010, the latest version of electric vehicle controller xc836 programs, including all the features, BK, CR, TA, TB, P1-P3
  3. 所属分类:微处理器(ARM/PowerPC等)

    • 发布日期:2012-01-11
    • 文件大小:69.27kb
    • 提供者:testsb
  1. IH_XC836_6G

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  2. 2010年最新版本电动车控制器xc836方案,包括所有功能,BK,CR,TA,TB,P1-P3-2010, the latest version of electric vehicle controller xc836 programs, including all the features, BK, CR, TA, TB, P1-P3
  3. 所属分类:ARM-PowerPC-ColdFire-MIPS

    • 发布日期:2017-04-03
    • 文件大小:69.27kb
    • 提供者:静水流深
  1. xapp930

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  2. RGB to Y CB CR conversion source code in VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:44.62kb
    • 提供者:niki
  1. CRCJIAOYAN

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  2. 本文介绍了CRC算法在单片机应用系统中的实现方法,通过一系列的理论推导,得到一种比较实用的8 位单片机系统CR C算法, 并给出了CR C码计算的汇编语言程序-This paper introduces the CRC algorithm in single-chip applications in the realization of methods, through a series of theoretical derivation, to be a more practical syst
  3. 所属分类:SCM

    • 发布日期:2017-04-01
    • 文件大小:75.09kb
    • 提供者:叶超
  1. fir

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  2. 利用Verilog语言编写的FPGA作为数字fir滤波器的程序,在编译器中调试通过,可以作为模块调用。-the model of fir digital cr which is written of verilog language.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:792byte
    • 提供者:saul
  1. print

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  2. 通用宽行打印机检测及打印程序PPRNT(如SENTRONICS标准并行接口的EPSON LQ-570型,FX-800型) 入口条件:设定外部中断(INT1)服务引导和开中断EA=1;欲打印数据放在片外 RAM中,首地址放在片内RAM双字节71H,72H中; ;;每行打印数据以CR和LF命令分割;以03为打印结束标志。 ;;出口条件:EX1=0时,打印结束-Universal wide-line printer detection and print program PPRNT
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-03-26
    • 文件大小:758byte
    • 提供者:张淼林
  1. 444

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  2. 实现智能数字显示仪表。要求8位数码管显示(4位显示测量值,4位显示设定值),4输入按钮(功能选择、数码管选择、数字增加、数字减少),可设定上下限报警(蜂鸣器报警)。K型热电偶(镍铬-镍硅),测温范围为0℃~1000℃。采用比例-积分控制、并用晶闸管脉宽调制驱动1000W电加热器(电源电压为AC220V)。-Intelligent digital display instrument. Asked 8-bit digital display (4 shows measured values, fo
  3. 所属分类:SCM

    • 发布日期:2017-04-08
    • 文件大小:246.37kb
    • 提供者:yaoming
  1. cr

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  2. 认知无线电的实现和使用,基于430和rf905-Cognitive Radio, based on 430 and rf905
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-06
    • 文件大小:80.48kb
    • 提供者:sed
  1. EDA5

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  2. 交通灯控制器设计:1.有MR(主红)、MY(主黄)、MG(主绿)、CR(乡红)、CY(乡黄)、CG(乡绿)六盏交通灯需要控制; 2.交通灯由绿→红有4秒黄灯亮的间隔时间,由红→绿没有间隔时间; 3.系统有MRCY、MRCG、MYCR、MGCR四个状态; 4.相间公路右侧各埋有一个传感器,当有车辆通过相间公路时,发出请求信号S; 5.平时系统停留在MGCR状态,一旦S信号有效,经MRCY转入MRCG状态,但要保证MRCG状态也不得短于一分钟; 6.一旦S信号无效,系统脱离MRC
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1013.35kb
    • 提供者:周旋
  1. AUTORUN_flashWrite_OK

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  2. 8051+Serial Flash, 將Flash模擬CR-ROM內容, 將USB驅動軟件置於Flash中, 可於微軟系統自動安裝驅動, 減少驅動軟件遺失的困擾.-8051+ Serial Flash, the Flash simulation CR-ROM content, placed on the USB Flash driver software, you can automatically install the driver on the Microsoft system, redu
  3. 所属分类:SCM

    • 发布日期:2017-04-03
    • 文件大小:234.47kb
    • 提供者:Spenser Tsai
  1. traffic

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  2. 一条主干道,一条乡间公路。组成十字路口,要求优先保证主干道通行。有MR(主红)、MY(主黄)、MG(主绿)、CR(乡红)、CY(乡黄)、CG(乡绿)六盏交通灯需要控制;交通灯由绿→红有4秒黄灯亮的间隔时间,由红→绿没有间隔时间;系统有MRCY、MRCG、MYCR、MGCR四个状态-A main road, a country road. Composition of the crossroads, requiring priority to ensuring the main road traf
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:213.02kb
    • 提供者:guo
  1. Simulate-CR-XR-EE-KT_2008_004

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  2. Simulate CR XR-EE-KT_2008_004
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.07mb
    • 提供者:MR TRUONG
  1. shiyanwu

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  2. 用VHDL编程实现一条主干道,一条乡间公路。组成十字路口,要求优先保证主干道通行。有MR(主红)、MY(主黄)、MG(主绿)、CR(乡红)、CY(乡黄)、CG(乡绿)六盏交通灯需要控制;交通灯由绿→红有4秒黄灯亮的间隔时间,由红→绿没有间隔时间;系统有MRCY、MRCG、MYCR、MGCR四个状态;-VHDL programming to a main road, a country road. Composed of a crossroads, requiring priority to en
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:132.85kb
    • 提供者:高华
  1. 500023-E-10_Counter_and_timer

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  2. 概要 本文档介绍了时基定时器,看门狗定时器、计时和多功能定时器的 API。-****************************************************************************** MB95200 Series I/O register declaration file V01L02 ALL RIGHTS RESERVED, COPYRIGHT (C) FUJITSU MICROELECTRONICS LIMITED 2008
  3. 所属分类:SCM

    • 发布日期:2017-11-30
    • 文件大小:351kb
    • 提供者:Shijie
  1. blank

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  2. 监控摄像头传入数据,通过芯片TVP5150转换成数字信号,其中sav_check.vhd检测帧头,converter.vhd将信号转换成Y,Cb,Cr格式,最后write_blank.vhd重新组建完整数字信号,最后通过ADV7171转成模拟信号输出到监视器上。这中间,可以对Y做各种图像处理,如滤波处理,均衡处理,只需要在converter之后添加处理文件即可。-Surveillance camera incoming data through the chip TVP5150 converte
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-21
    • 文件大小:6.28mb
    • 提供者:丁会
  1. SDI_controller

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  2. 项目:用到FPGA驱动GV7600输出SDI信号,输出分辨率1920*1080p,首先,了解GV7600芯片的特性功能,按照bt1120协议传输10位Y,Cb,Cr数据;其次,我的项目中用的是10位通道分时复用传输Y,Cb,Cr数据;配置引脚很重要,当初verilog代码写好了,因为硬件引脚配置错误,导致调试一直不通;同时,sof文件也要一直更新(Based on FPGA to design the drive controller of GV7600)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-09-13
    • 文件大小:2.48mb
    • 提供者:Davemissyou
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