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本程序是通过AD校正来提高2812 AD采样的精度，AD采样频率为10K，序列发生器SEQ1和SEQ2级联成一个16通道的序列发生器， 采样模式采用顺序采样。利用通用定时器T1的周期中断事件来启动AD转换。
ADCINA0和ADCINB0为参考电平，实际的电压值分别为0.420和1.653,此例程对 ADCINA0、ADCINA1、ADCINB0、ADCINB1四个通道进行连续10次的采样，然后对各个通道的10个采样值进行排序，滤波，最后取平均值。然后由ADCINA0 和ADCINB0通道
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With the program AD9854C.exe one can set and tune the frequency in CW-mode. For use as a receiver LO also IF can be given and the both possible receiving frequencies are printed on the screen. The level in Q-outputs can be varied by giving the wanted
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此为使用周立功ARM1138编的音频分析仪的代码，主要包括FFT运算、测频校正算法、以周立功TFT液晶LTM024D130的驱动文件为基础编的LCD显示的用户界面，使用的IAR V5.11(32KB限制)下进行编程-This is audio analyzer code based on the ZLG ARM1138, mainly including FFT operation, frequency measurement correction algorithm and LCD displ
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芯片组（Chipset）是主板的核心组成部分，按照在主板上的排列位置的不同，通常分为北桥芯片和南桥芯片。北桥芯片提供对CPU的类型和主频、内存的类型和最大容量、ISA/PCI/AGP插槽、ECC纠错等支持。南桥芯片则提供对KBC（键盘控制器）、RTC（实时时钟控制器）、USB（通用串行总线）、Ultra DMA/33(66)EIDE数据传输方式和ACPI（高级能源管理）等的支持。其中北桥芯片起着主导性的作用，也称为主桥（Host Bridge）。 -Chipset (Chipset) is a
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通过AD校正来提高2812 AD采样的精度，AD采样频率为10K，序列发生器SEQ1和SEQ2级联成一个16通道的序列发生器，采样模式采用顺序采样。利用通用定时器T1的周期中断事件来启动AD转换。-By AD 2812 AD correction to improve the accuracy of sampling, AD sampling frequency of 10K, the sequence generator SEQ1 and SEQ2 cascaded into a 16-cha
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Altem公司quartus
II 8．1开发环境下，完成了中频全数字解调器的FPGA实现，并对数
字下变频、载波同步、位同步等解调器的核心模块设计进行了详细的分析和说明，给出
了实现框图和仿真波形。同时在本设计中应用了Altera公司的NiosII软核处理器技术，
用于载波的大频偏校正和解调器各个部分的监测和控制。最后给出了QPSK中频全数字
解调器关键性能指标的测试方法和测试结果，测试结果表明本设计达到了预期的性能指
标要求。-The Algorithm is con
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1. 测量方式可以随被测信号的频率变化自动进行切换，>1000Hz时，定时计数方式；<900Hz时，测周期,切换点可以随时自定义，可以做到最佳的匹配。
2. 可以通过改变晶振或者单片机来提高测量范围，有四个常用晶振的宏选择
3. 精度高，通过软件修正、再配合高频晶振以及更换单周期指令的单片机，高频时，可以做到+-2Hz的误差。-1. A measurement with the measured signal frequency changes automatic
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AD采样频率为10K，序列发生器SEQ1和SEQ2级联成一个16通道的序列发生器，采样模式采用顺序采样。利用通用定时器T1的周期中断事件来启动AD转换。ADCINA0和ADCINB0为参考电平，实际的电压值分别为0.420和1.653,由于每个板子的具体特性稍有不同，请用万用表自行测量参考电压值。此例程对ADCINA0、ADCINA1、ADCINB0、ADCINB1四个通道进行连续10次的采样，然后对各个通道的10个采样值进行排序，滤波，最后取平均值。然后由ADCINA0和ADCINB0通道的值
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AD采样频率为10K，序列发生器SEQ1和SEQ2级联成一个16通道的序列发生器，此例程对ADCINA0、ADCINA1、ADCINB0、ADCINB1四个通道进行连续10次的采样，然后对各个通道的10个采样值进行排序，滤波，最后取平均值。然后由ADCINA0和ADCINB0通道的值计算求得CalGain和CalOffset，最后由这两个量来校正ADCINA1和ADCINB1。-AD sampling frequency for the 10K, the sequence generator S
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设计一个智能化的数据采集和电压监控系统，该系统以单片机为核心并具有如下功能：1）能对2-4v范围变化的模拟信号进行连续采样（模拟信号中有尖峰脉冲干扰和50Hz工频干扰）和实时数字显示，采样周期为1秒，保存最近的50个连续采样值；2）当采样值小于2v时1个报警灯闪烁，大于4v时2个报警灯闪烁；3）能对存在的系统误差进行线性插值校正；4）能和上位机进行串行通信，根据上位机的要求随时将采样数据上传；5）能产生占空比为10 幅度为5v的100Hz脉冲波供外设用。智能电压监控系统-Design an in
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基本功能：
1、输入1KHZ的时钟；
2、能显示时、分、秒，24小时制；
3、时和分有校正功能；
4、当计时器运行到59分49秒开始报时，每鸣叫1s就停叫1s，共鸣叫6响；前5响为低音，频率为500HZ；最后一响为高音，频率为1KHZ；
5、可设定夜间某个时段不报时；
6、设定闹钟。
-Basic functions: input 1kHz clock 2, display hours, minutes, seconds, 24-hour clock 3, hou
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mega128定时器1的频率和相位修正模式产生的PWM波形-mega128 timer PWM waveform frequency and phase correction mode 1 produced
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mega128定时器3的频率和相位修正模式产生的PWM波形-mega128 timer PWM waveform frequency and phase correction mode 3 is generated
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mega128定时器1的频率和相位修正模式产生的PWM波形123-mega128 timer PWM waveform frequency and phase correction mode 1 produced123
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mega128定时器3的频率和相位修正模式产生的PWM波形123
-mega128 timer PWM waveform frequency and phase correction mode 3 is generated123
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这个是我用CCS3。3做的一个AD采样，其中用到了数字滤波，采样频率可根据自己的须要做调整，经过校正后采样数据还比较准-This is my CCS3. A AD 3 to do sampling, which uses digital filtering, sampling can be adjusted according to their own needs to frequency, after correction of sampling data is accurate
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上一节讲了利用累计定时中断次数实现LED灯闪烁，这个例子同时也第一次展示了我最完整的实战程序框架：
用switch语句实现状态机，外加定时中断。这个框架看似简单，实际上就是那么简单。我做的所有开发项目都是基于这个简单框架，
但是非常好用。上一节只有一个单任务的LED灯在闪烁，这节开始，我们多增加一个蜂鸣器报警的任务，要教会大家四个知识点：
第一点：蜂鸣器的驱动程序框架编写。
第二点：多任务处理的程序框架。
第三点：如何控制蜂鸣器声音的长叫和短叫。
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三角波幅度，频率，斜率测量程序,滤波，数据修正-Triangle wave amplitude, frequency, slope measurement procedures, filtering, data correction
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自己工作需要，需输出可调脉宽、频率的PWM波，网上找的资料都是介绍AVR快速PWM的，没有使用AVR相頻修正实现PWM控制的。就自己查资料，仿真、做板子。自己做了一个，调试通过了，如果需实际使用，部分参数需稍加修正。
功能：AVR ATmega16 相頻修正PWM波实现
涉及模块：7Seg(7段数码管驱动)
键盘扫描(包括长按和短按，稍加修改可实现多键检测)
定时器0,2的定时使用
定时器1的相頻修正PWM输出
PWM频率范围：0.1-99.9Hz，占空比：
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本频率计基于CPLD/FPGA实现。 50MHZ标准频率为CPLD内部时钟信号，被测方波为信号发生器产生的方波信号，显示电路由TTL芯片及七段数码管组成的电路，自校正输出由CPLD输出已知频率的测试方波信号，可将其输入至测试端口，进行系统精度校正。 -The frequency meter based on CPLD/FPGA implementation. 50MHZ standard CPLD internal clock signal frequency, square-wave test
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