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搜索资源列表

  1. lab5

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  2. VHDL xilinx例子-vhdl xilinx example............
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:571.57kb
    • 提供者:hojone
  1. LAB5

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  2. 七人表决器 七个按键,若按下个数多于三个,表示通过,LED点亮-Seven voting machines seven keys, press the number if more than three, said that through, LED lights
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:608.06kb
    • 提供者:wonder
  1. lab5

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  2. m*n的ram,包含m*n个ram,使用VHDL编译,可在xilinx里面运行-m* n the ram, contains m* n a ram, using the VHDL compiler, which can be run in xilinx
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:21.66kb
    • 提供者:gao
  1. Lab5(sequence-detector)

    0下载:
  2. sequence detetect on spartan 3e...vhdl code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:3.12kb
    • 提供者:vikas
  1. Computer-Architecture-lab5

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  2. 计算机组成实验作业5,fpga开发板,verilog语言编写-Composition of experimental computer operating 5, fpga development board, verilog language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-18
    • 文件大小:4.82mb
    • 提供者:聪聪
  1. Lab_5-Dice-Game

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  2. dice_game该程序可重现赌场游戏掷骰子. 游戏规则详见上传的LAB5实验描述。-dice_game The program can reproduce the casino game craps the game rules see the uploaded LAB5 experiments described.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:756.18kb
    • 提供者:廖成晨
  1. lab5

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  2. xilinx大学计划的第五个实验,有极高的参考价值。-Xilinx university plans fifth experiment, have the extremely high reference value.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-15
    • 文件大小:3.78mb
    • 提供者:孙洪君
  1. lab5

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  2. Verilog 程序 可以实现带进位的8bit加法和减法-The Verilog procedures can achieve 8bit addition and subtraction with carry
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-16
    • 文件大小:245.21kb
    • 提供者:Xin wang
  1. lab5

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  2. de2 altera 实验6 Adders, Subtractors, and Multipliers 答案-de2 altera experiment 5 Adders, Subtractors, and Multipliers answer
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-03
    • 文件大小:2.49mb
    • 提供者:shuang
  1. Lab5.5_Led_FPGA

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  2. 流水灯的详细代码,并且在开发板上运行通过-Light water detailed code, and run through the development board
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:9.4kb
    • 提供者:tianming
  1. lab5

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  2. 用xilinx ISE14.3开发的单周期CPU系统,面向spartan Ⅲ板,仿真调试与实际测试均已通过。-Developed by xilinx ISE14.3 single-cycle CPU system, facing the spartan Ⅲ board simulation debugging and practical tests have passed.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-12
    • 文件大小:2.92mb
    • 提供者:张宇轩
  1. Lab5.5_Led_FPGA

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  2. 使用verilog在fpga开发板实现流水灯,包括整个工程文件-This code is used for early learners to study verilog。
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-23
    • 文件大小:10.01kb
    • 提供者:xiaofengyu
  1. Lab5.5_Led_FPGA

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  2. Verilog LED FPGA仿真程序-Verilog LED FPG
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:236.77kb
    • 提供者:李狗蛋
  1. Lab5

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  2. 此為VHDL之非同步觸發、清除之單擊電路與同步觸發、清除之單擊電路設計-This is a non-synchronous triggering of VHDL, click to clear the circuit and synchronization trigger, click to clear the circuit design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.13mb
    • 提供者:
  1. lab5

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  2. 上传的文档以及代码是利用system generator来实现一些简单功能的实例,主要给system generator初学者一些参考-Upload documents and code using system generator to implement some simple examples of functions, primarily to beginners some reference system generator
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:308.59kb
    • 提供者:檀雨
  1. lab5

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  2. Verilog lab5 is used for learning vivado
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-22
    • 文件大小:7kb
    • 提供者:Chappa
  1. lab5

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  2. 串口控制器,基于vivado软件下开发,包含代码及管脚分配文件(Serial port controller)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-07
    • 文件大小:7.03mb
    • 提供者:DukeLancelot
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