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  1. IR2184S_-_HALF-BRIDGE_DRIVER.rar

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  2. The IR2184(4)(S) are high voltage, high speed power MOSFET and IGBT drivers with dependent high and low side referenced output channels. Pro- prietary HVIC and latch immune CMOS technologies enable rugge- dized monolithic construction. The logic inpu
  3. 所属分类:其它文档

    • 发布日期:2011-10-28
    • 文件大小:174.14kb
    • 提供者:5821594
  1. 74ls595.rar

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  2. 单片机与74LS595(8位输出锁存移位寄存器)的使用方法 74595的数据端: QA--QH: 八位并行输出端,可以直接控制数码管的8个段。 QH : 级联输出端。我将它接下一个595的SI端。 SI: 串行数据输入端 ......... ,SCM and 74LS595 (8-bit output latch shift register) 74595 to use the data side: QA- QH: 8 parallel output can directly co
  3. 所属分类:Project Manage

    • 发布日期:2017-03-25
    • 文件大小:4.99kb
    • 提供者:eric
  1. ds18b20

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  2. 在数码管上面显示DS18B20转换出来的时间,数码管里面有两个377的锁存器,来控制段选和位选,这个时间可以精确到小数点后面一位.-DS18B20 shown above in the digital conversion out of time, there are two digital latch 377 to control the selection and position selection section, this time can be accurate to one dec
  3. 所属分类:software engineering

    • 发布日期:2017-04-07
    • 文件大小:1.7kb
    • 提供者:陈久
  1. chengxu

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  2. 设计制作一个可容纳4组参赛者的数字智力抢答器,每组设置一个抢答按键; 电路具有一第一抢答信号的鉴别和锁存的功能。在主持人将系统复位并发出抢答指令后,若参加者按抢答键,则该组指示灯亮并用组别显示抢答者的组别。此时,电路具有自锁功能,使别组的抢答开关不起作用。 设置计分电路。每组在开始时预置成6分,抢答后主持人计分,答对一次加1分。-The design can accommodate a the Entrants digital intellectual Responder, each s
  3. 所属分类:Document

    • 发布日期:2017-04-03
    • 文件大小:4.75kb
    • 提供者:何婕婕
  1. Digital_Responder(Digital_Circuit)

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  2. 数字抢答器由主体电路与扩展电路组成。优先编码电路、锁存器、译码电路将参赛队的输入信号在显示器上输出;用控制电路和主持人开关启动报警电路,以上两部分组成主体电路。通过定时电路和译码电路将秒脉冲产生的信号在显示器上输出实现计时功能,构成扩展电路。经过布线、焊接、调试等工作后数字抢答器成形。-Answer the number is controlled by the main circuit and the expansion of circuit components. Priority enco
  3. 所属分类:Communication

    • 发布日期:2017-03-29
    • 文件大小:55.33kb
    • 提供者:张堃
  1. shuziqiangdaqi123

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  2. 数字抢答器(数字电路)【课程设计】数字抢答器由主体电路与扩展电路组成。优先编码电路、锁存器、译码电路将参赛队的输入信号在显示器上输出;用控制电路和主持人开关启动报警电路,以上两部分组成主体电路。通过定时电路和译码电路将秒脉冲产生的信号在显示器上输出实现计时功能,构成扩展电路。经过布线、焊接、调试等工作后数字抢答器成形。-Answer the number of devices (digital circuit) curriculum design】 【Answer is controlled b
  3. 所属分类:software engineering

    • 发布日期:2017-04-05
    • 文件大小:54.88kb
    • 提供者:jdz
  1. STUDENTS_SCORE

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  2. Specifications 1. Top module name :SS (File name : SS.v) 2. Input pins: CLK, RESET, IN_VALID, INPUT [6:0] - 2 - 3. Output pins: OUT_VALID, OUTPUT [6:0] 4. Synchronous active high RESET is used, and no latch design is allowed. 5. All input
  3. 所属分类:Project Design

    • 发布日期:2017-05-13
    • 文件大小:3.2mb
    • 提供者:chen-che,wemg
  1. Advanced_Verilog_Design

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  2. 以Lattice 器伴为例,描述如何在Verilog中指定管脚属饪功能(OE,RESET,IO CELL寄存器,双向IO,Latch IO,管脚Pin number, synthesis属性,输出电气规格...),状态机的使用,及其它Verilog进阶功能-With Lattice devices for example, it describes how to specify the pin function in Verilog (OE, RESET, IO CELL register, b
  3. 所属分类:software engineering

    • 发布日期:2017-04-05
    • 文件大小:124.43kb
    • 提供者:Tim
  1. LESSON4

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  2. 动态显示的特点是将所有位数码管的段选线并联在一起,由位选线控制是哪一位数码管有效。这样一来,就没有必要每一位数码管配一个锁存器,从而大大地简化了硬件电路。选亮数码管采用动态扫描显示。所谓动态扫描显示即轮流向各位数码管送出字形码和相应的位选,利用发光管的余辉和人眼视觉暂留作用,使人的感觉好像各位数码管同时都在显示。动态显示的亮度比静态显示要差一些,所以在选择限流电阻时应略小于静态显示电路中的。 -Dynamic display features all the bits of digital
  3. 所属分类:software engineering

    • 发布日期:2017-03-29
    • 文件大小:237.63kb
    • 提供者:小北
  1. Digitalcalendaclock

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  2. 本次做的数字日历是以单片机(AT89C51)为核心,结合相关的元器件(共阴极LED数码显示器、BCD-锁存/7段译码/驱动器74LS164等),再配以相应的软件,达到制作简易数字日历的目的,其硬件部分难点在于元器件的选择、布局及焊接。-The figures do bell on SCM (AT89C51) at the core, Combined with the components (a total of cathode LED digital display, BCD- latch
  3. 所属分类:Communication

    • 发布日期:2017-04-16
    • 文件大小:136.69kb
    • 提供者:c51com
  1. kaitibaogao

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  2. 实现CPLD对数据选择器,A/D转换器,锁存器及DPRAM的控制-CPLD implementation of the Data Selector, A/D converter, the control latch and DPRAM
  3. 所属分类:Project Design

    • 发布日期:2017-04-03
    • 文件大小:10.96kb
    • 提供者:李树龙
  1. shuzi

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  2. 设计一个采用数字电路实现,对时,分,秒.数字显示的计时装置,周期为24小时,显示满刻度为23时59分59秒,并具有校时功能和报时功能的数字电子钟。电路主要采用中规模集成电路.本系统的设计电路由脉冲逻辑电路模块、时钟脉冲模块、时钟译码显示电路模块、整电报时模块、校时模块等部分组成。采用电池作电源,采用低功耗的芯片及液晶显示器,发生器使用石英晶振、计数振荡器CD4060及双D触发器74LS74,计数器采用同步双十进制计数器74LS160,锁存译码器是74LS248,整电报时电路用74LS74,74L
  3. 所属分类:Document

    • 发布日期:2017-03-30
    • 文件大小:438.78kb
    • 提供者:张龙
  1. ver1.0

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  2. Shutdown of the UC1842 can be accomplished by two methods either raise pin 3 above 1 V or pull pin 1 below a voltage two diode drops above ground. Either method causses the output of the PWM comparator to be high (refer to block diagram). The PWM
  3. 所属分类:Project Design

    • 发布日期:2017-03-23
    • 文件大小:873byte
    • 提供者:prxbl
  1. ADC0809

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  2. ADC0809 是8 位逐次逼近型A/D转换器。它由一个8路模拟开关、一个地址锁存译码器、一个A/D 转换器和一个三态输出锁存器组成(见图1)。多路开关可选通8个模拟通道,允许8 路模拟量分时输入,共用A/D 转换器进行转换。三态输出锁器用于锁存A/D 转换完的数字量,当OE 端为高电平时,才可以从三态输出锁存器取走转换完的数据。-ADC0809 8-bit successive approximation A/D converter. It consists of an 8-channel a
  3. 所属分类:software engineering

    • 发布日期:2017-04-01
    • 文件大小:220.86kb
    • 提供者:lanying
  1. miaobiao

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  2. 这是锁存器的基本应用,希望能给初学者点帮助-This is the latch of the basic applications, I hope to give some help for beginners
  3. 所属分类:software engineering

    • 发布日期:2017-04-02
    • 文件大小:15.79kb
    • 提供者:WADE
  1. digitalppt

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  2. 数字设计课件ppt,基本的门,译码器,编码器,多路复用器,比较器,锁存器,触发器等-Digital design courseware ppt, basically the door, decoder, encoder, multiplexer, comparator, latch, trigger, etc.
  3. 所属分类:software engineering

    • 发布日期:2017-06-03
    • 文件大小:14.44mb
    • 提供者:刘备
  1. BL75R04-keil

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  2. BL75R04SM 2K 位EEPROM 射频识别 射频接口完全符合ISO15693标准 该程序可进行数据数据的多读写等操作 BL75R04SM 是遵从 ISO/IEC15693 无线接口的2Kbit 电子标签芯片。可制作成电子 标签或非接触卡,主要适用于大中型物流、商品防盗防伪、工业控制、门禁系统、军 事跟踪、路桥收费、畜牧养殖、图书文档管理、特种设备和金融票据等领域。具备防 2 冲突功能,读写器能同时快速处理多个芯片。片内2K 位 E PR
  3. 所属分类:software engineering

    • 发布日期:2017-04-01
    • 文件大小:163.04kb
    • 提供者:zakailynn
  1. BL75R04

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  2. 继上次源码开放后,本次把BL芯片信息公开下载,供大家与程序操作 BL75R04SM 是遵从 ISO/IEC15693 无线接口的2Kbit 电子标签芯片。可制作成电子 标签或非接触卡,主要适用于大中型物流、商品防盗防伪、工业控制、门禁系统、军 事跟踪、路桥收费、畜牧养殖、图书文档管理、特种设备和金融票据等领域。具备防 2 冲突功能,读写器能同时快速处理多个芯片。片内2K 位 E PROM,分成64block, 每 block 有4 字节的数据存储区,
  3. 所属分类:File Formats

    • 发布日期:2017-04-17
    • 文件大小:193.19kb
    • 提供者:zakailynn
  1. skdy

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  2. 数控电源,有矩阵键盘中断,快速+/-步进,数码管驱动(带锁存器)。pwm部分请自行调试。-NC Power, a matrix keyboard interrupt, fast+ /- step, the digital drive (with latch). pwm part of your own debugging.
  3. 所属分类:software engineering

    • 发布日期:2017-04-05
    • 文件大小:2.08kb
    • 提供者:
  1. 74AHC_AHCT573

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  2. 74AHCT573 consists of eight D-type transparent latches featuring separate D-type inputs for each latch and 3-state true outputs for bus oriented applications
  3. 所属分类:software engineering

    • 发布日期:2017-04-03
    • 文件大小:122.93kb
    • 提供者:vikram
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