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  1. A New Phase-Locked Loop (PLL) System

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  2. An enhanced phase-locked loop (PLL) system is presented and its properties and performance characteristics are investigated. Advantages of the proposed PLL structure over the conventional PLLs including its capability of direct estimation of ampli
  3. 所属分类:文档资料

    • 发布日期:2010-09-17
    • 文件大小:409.01kb
    • 提供者:yangyansky
  1. dainlu

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  2. 此开关稳压电源由AT89S52单片机作为控制核心。系统包括AD采样,PID控制,PWM输出,构成闭环系统。交流电源输入到整流模块,经整流滤波后输出平稳的直流电压。该直流电压直接输出至IGBT全桥变换器模块。高精度AD转换器将后端输出的电压电流信号由模拟信号量变为数字量供给单片机进行数字PlD运算,经过PID控制运算后,由控制模块输出PWM调制波形至IGBT栅极,构成一个闭环系统,控制电压稳定输出,从而实现开关稳压电源控制系统。此外,可由键盘输入欲得电压值,从LCD显示实际电压值,人机交互界面友好
  3. 所属分类:Project Design

    • 发布日期:2017-03-22
    • 文件大小:45.21kb
    • 提供者:周陶钧
  1. xPCTargetManual

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  2. xPC Target 工具箱使你可以在 Simulink 的框图中加入 I/O 方块图,并用 RTW 产生代码,最后下载到另一个运行 xPC Target 实时内核的 PC 机上。对于控制和 DSP 系统来说 xPC Target 是理想的快速原型和硬件在回路测试工具,它可以使你在一台标准的 PC 机上运行实时模型。如果附加 xPC Target 嵌入模块选项,你可以把你的实时嵌入式系统放入到一台微机上,应用于生产、数据采集、标定和测试应用程序等过程中。 -xPC Target toolb
  3. 所属分类:Communication

    • 发布日期:2017-05-27
    • 文件大小:9.42mb
    • 提供者:joey
  1. The-basics-of-Loop-Vehicle-Detection

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  2. The basics of Loop Vehicle Detection
  3. 所属分类:Project Design

    • 发布日期:2017-10-31
    • 文件大小:405.35kb
    • 提供者:ThadkQk
  1. GPSINSUAV

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  2. Development of GPS INS Loop for UAV
  3. 所属分类:Communication

    • 发布日期:2017-05-12
    • 文件大小:2.83mb
    • 提供者:ztlits
  1. Phase_Locked_Loop

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  2. Very good code for Phase locked Loop in matlab
  3. 所属分类:Document

    • 发布日期:2017-04-13
    • 文件大小:2.32kb
    • 提供者:Paul
  1. dcdianji

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  2. 电流与转速双闭环直流调速系统的设计与研究,详细论文设计-Current and speed Double Loop DC Motor Control System Design and Research, a detailed paper design
  3. 所属分类:Project Manage

    • 发布日期:2017-04-05
    • 文件大小:139.99kb
    • 提供者:无名
  1. si4133-datasheet

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  2. 该Si4133是一个单片集成电路,既执行IF和双频 RF合成为无线通信应用。在Si4133 包括三个和VCO,环路滤波器,参考和VCO分频器,相位 探测器。除法和可编程掉电设置与threewire 串行接口。-The Si4133 is a monolithic integrated circuit, both the implementation of the IF and dual-band RF synthesis for wireless comm
  3. 所属分类:Project Design

    • 发布日期:2017-03-31
    • 文件大小:458.5kb
    • 提供者:峰之巅
  1. PLL_1

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  2. Block model of a phase locked loop implemented in Simulink. Step 1 of a series of 5 developed models.
  3. 所属分类:Project Design

    • 发布日期:2017-04-01
    • 文件大小:6.39kb
    • 提供者:dirome
  1. PLL2

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  2. Block model of a phase locked loop implemented in Simulink. Step 2 of a series of 5 developed models.
  3. 所属分类:Project Design

    • 发布日期:2017-04-01
    • 文件大小:3.17kb
    • 提供者:dirome
  1. PLL3

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  2. Block model of a phase locked loop implemented in Simulink. Step 3 of a series of 5 developed models.
  3. 所属分类:Project Design

    • 发布日期:2017-04-14
    • 文件大小:5.4kb
    • 提供者:dirome
  1. time_model_PLL

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  2. Block model of a phase locked loop implemented in Simulink. Step 4 of a series of 5 developed models.
  3. 所属分类:Project Design

    • 发布日期:2017-04-15
    • 文件大小:6.52kb
    • 提供者:dirome
  1. time_model_PLL1

    0下载:
  2. Block model of a phase locked loop implemented in Simulink. Step 5 of a series of 5 developed models.
  3. 所属分类:Project Design

    • 发布日期:2017-04-15
    • 文件大小:6.63kb
    • 提供者:dirome
  1. CarrieRecoveryUsingaSecondOrderCostasLoop

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  2. Carrier Recovery Using a Second Order Costas Loop
  3. 所属分类:Document

    • 发布日期:2017-04-17
    • 文件大小:203.32kb
    • 提供者:jack
  1. msp430f149dpj

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  2. 利用MSPd30F149 单片机和AIM21电流环芯片,通过简单的压频转换(多谐振荡器)电路实现了基于电客式差压 传感器的智能差压变送器设计。该设计的特点是利用压频转换电路取代了A/D模块,以极低的产品价格达到了较高的 系统测量精度。采用软件与硬件相结合的信号处理技术,实现了基于HART协议现场总线技术的差压模拟量的测量,通 过进一步采用CPLD器件的量化延时测频技术,将可以达到比传统A/D器件更高的压力测量精度。智能差压变送器;HART协议现场总线;MSP430F149;AIM21
  3. 所属分类:Project Design

    • 发布日期:2017-03-23
    • 文件大小:147.78kb
    • 提供者:别问
  1. Carrier_Recovery_Using_a_Second_Order_Costas_Loop.

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  2. 本文详细的介绍了一个数字科斯塔环的具体实现,并且附有matlab仿真代码,基于AM调制,以及希尔伯特变换-This paper introduces a concrete realization of digital Costas loop, and with matlab simulation code, based on AM modulation, as well as the Hilbert transform
  3. 所属分类:Document

    • 发布日期:2017-03-26
    • 文件大小:236.6kb
    • 提供者:hejie
  1. Digital_Costas_loop_in_FPGA_Design_and_Implementat

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  2. 全数字Costas环在FPGA上的设计与实现-Digital Costas loop in FPGA, Design and Implementation
  3. 所属分类:Project Design

    • 发布日期:2017-03-29
    • 文件大小:267.48kb
    • 提供者:王新雨
  1. digital_pll

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  2. 传统的数字锁相环系统是希望通过采用具有低通特性的环路滤波器,获得稳定的振荡控制数据由于数字电子技术的迅速发展,尤其是数字计算和信号处理技术在多媒体、自动化、仪器仪表、通讯等领域的广泛应用,用数字电路处理模拟信号的情况日益普遍。所以模拟信号数字化是信息技术的发展趋势,而数字锁相环在其中扮演着重要角色。-Conventional digital PLL system is to have a low-pass characteristics by using the loop filter to o
  3. 所属分类:File Formats

    • 发布日期:2017-04-01
    • 文件大小:284.83kb
    • 提供者:刘强为
  1. loop-structure-of-programming

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  2. 第6章 循环结构程序设计 for语句的语法格式-Chapter 6 loop structure of programming syntax for statement
  3. 所属分类:software engineering

    • 发布日期:2017-03-25
    • 文件大小:210.95kb
    • 提供者:华冰山
  1. 1111111111111

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  2. 一种感应线圈车辆检测器的抗干扰方法,An Induction Loop Vehicle Detector interference method-An Induction Loop Vehicle Detector interference method
  3. 所属分类:software engineering

    • 发布日期:2017-04-07
    • 文件大小:112.47kb
    • 提供者:几几
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